74LS01 Compuerta NAND 2 entradas
$15.00
9 en stock
Sin impuestos
El integrado 74LS01 contiene 4 compuertas NAND de 2 entradas y 1 salida de colector abierto (open collector), por lo que requieren de resistencias de pull-up para operar correctamente.
Las letras LS indican chip de modelo Schottky de bajo consumo.
Los dispositivos de colector abierto se utilizan comunmente para generar altos nivelses de VOH.
Tensión de alimentación: 5V
Niveles lógicos: 0.2V - 0.8V para el nivel bajo (low,0) Y 2.4V - 5V para el nivel alto (high,1)
Operador: NAND
Margen de ruido: 0.7V para nivel alto y 0.3V para nivel bajo.
Descripción de terminales:
Pin 1: el resultado de la operación de la primer compuerta.
Pin 2: la entrada A de la compuerta 1.
Pin 3: la entrada B de la compuerta 1.
Pin 4: el resultado de la operación de la segunda compuerta.l
Pin 5: La entrada A de la compuerta 2.
Pin 6: la entrada B de la compuerta 2.
Pin 7: GND
Pin 8: la entrada A de la compuerta 4.
Pin 9: la entrada B de la compuerta 4.
Pin 10: el resultado de la operación de la cuarta compuerta.
Pin 11: la entrada A de la compuerta 3.
Pin 12: la entrada B de la compuerta 3.
Pin 13: el resultado de la operación de la tercer compuerta
Pin 14: VCC.
Política de seguridad
(editar con el módulo de Información de seguridad y confianza para el cliente)
Política de entrega
(editar con el módulo de Información de seguridad y confianza para el cliente)
Política de devolución
(editar con el módulo de Información de seguridad y confianza para el cliente)
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El integrado 74LS01 contiene 4 compuertas NAND de 2 entradas y 1 salida de colector abierto (open collector), por lo que requieren de resistencias de pull-up para operar correctamente.
Las letras LS indican chip de modelo Schottky de bajo consumo.
Los dispositivos de colector abierto se utilizan comunmente para generar altos nivelses de VOH.
Tensión de alimentación: 5V
Niveles lógicos: 0.2V - 0.8V para el nivel bajo (low,0) Y 2.4V - 5V para el nivel alto (high,1)
Operador: NAND
Margen de ruido: 0.7V para nivel alto y 0.3V para nivel bajo.
Descripción de terminales:
Pin 1: el resultado de la operación de la primer compuerta.
Pin 2: la entrada A de la compuerta 1.
Pin 3: la entrada B de la compuerta 1.
Pin 4: el resultado de la operación de la segunda compuerta.l
Pin 5: La entrada A de la compuerta 2.
Pin 6: la entrada B de la compuerta 2.
Pin 7: GND
Pin 8: la entrada A de la compuerta 4.
Pin 9: la entrada B de la compuerta 4.
Pin 10: el resultado de la operación de la cuarta compuerta.
Pin 11: la entrada A de la compuerta 3.
Pin 12: la entrada B de la compuerta 3.
Pin 13: el resultado de la operación de la tercer compuerta
Pin 14: VCC.